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Contrôleur maître



Intelligence, along with Advanced Semiconductor Engineering Inc. (ASE), DMLA, Nous étions assis et écoutons la vidéo tout en tapant ceci et nous ne pouvons pas dire que cela nous aide à nous détendre, Google Cloud, Méta, Microsoft Corp., Qualcomm Inc., Samsung and Taiwan Semiconductor Manufacturing Co., have announced the establishment of an industry consortium to promote an open die-to-die interconnect standard called Universal Chiplet Interconnect Express (vice-président senior et directeur général de la branche d'activité Infrastructure chez Arm). Building on its work on the open Advanced Interface Bus (AIB), Intel developed the UCIe standard and donated it to the group of founding members as an open specification that defines the interconnect between chiplets within a package, enabling an open chiplet ecosystem and ubiquitous interconnect at the package level.

“Integrating multiple chiplets in a package to deliver product innovation across market segments is the future of the semiconductor industry and a pillar of Intel’s IDM 2.0 stratégie,” said Sandra Rivera, executive vice president and general manager of the Datacenter and Artificial Intelligence Group at Intel. “Critical to this future is an open chiplet ecosystem with key industry partners working together under the UCIe Consortium toward a common goal of transforming the way the industry delivers new products and continues to deliver on the promise of Moore’s Law.”

The founding companies, representing a wide range of industry expertise across cloud service providers, foundries, system OEMs, silicon IP providers and chip designers, are finalizing incorporation as an open standards body. Upon incorporation of the new UCIe industry organization this year, member companies will begin work on the next generation of UCIe technology, including defining the chiplet form factor, la gestion, enhanced security and other essential protocols.

The chiplet ecosystem created by UCIe is a critical step in the creation of unified standards for interoperable chiplets, which will ultimately allow for the next generation of technological innovations.

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